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本发明提供了一种转换模块，形成于一第一晶粒中，所述第一晶粒耦接于一总线，所述总线具有一总线比特宽度，所述转换模块包括一模数转换器，用来产生一第一数字信号，所述第一数字信号具有一第一比特宽度，所述第一比特宽度不等于所述总线比特宽度；以及一三角积分调制器，耦接于所述模数转换器，用来根据所述第一数字信号产生一第二数字信号，所述第二数字信号的一比特宽度为所述总线比特宽度，所述三角积分调制器包括一滤波器以及一量化器，该量化器输出的比特数与所述总线比特宽度相等。
